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HME-P1系列（P1P060）采用成熟的40nm CMOS工藝，提供全新更高效的雙寄存器加LUT6架構(gòu)和豐富的內(nèi)置系統(tǒng)級(jí)模塊選擇，其中包括18Kb（2 x 9Kb）RAM模塊、第二代DSP56V1 Slice、DDR存儲(chǔ)控制器和PHY、增強(qiáng)型PLL和時(shí)鐘管理模塊、功率優(yōu)化的高速串行收發(fā)器模塊、PCI Express?兼容端點(diǎn)模塊、高級(jí)系統(tǒng)級(jí)電源管理模式、1MSPS XADC、自動(dòng)檢測(cè)配置選項(xiàng)以及具有AES保護(hù)的增強(qiáng)型IP安全。
特性
40nm CMOS 工藝
采用全新的LUT6構(gòu)架
等價(jià)于60K 4輸入LUT邏輯單元
高達(dá)6.5G bps Serdes高速I/O
1333M bps硬核DDR2/3控制和PHY
硬核PCIe Gen1/Gen2
針對(duì)需要高速率高性能大容量的FPGA市場(chǎng)
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型號(hào) |
P1P060 |
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可編程邏輯塊（PLB） |
邏輯單元Logic cells |
58,982 |
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查找表LUT6 |
36,864 |
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DFF寄存器 Register (DFF-based) |
73,728 |
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嵌入式內(nèi)存模塊（EMB） |
LRAM |
576Kb |
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18Kb EMB |
144 |
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9Kb EMB |
288 |
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總EMB |
2,592Kb |
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時(shí)鐘&鎖相環(huán) |
PLL |
4 |
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全局時(shí)鐘 |
32 |
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DSP |
DSP Slice (DSP56V1) |
144 |
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18x18 乘法器 |
288 |
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硬核IP |
PCI Express Gen1/2 |
1 |
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DDR2/3 (PHY & controller) (1) |
1 |
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Transceiver |
Configurable 300M~6.5G | 4 | |||
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XADC(1MSPS) (2) |
2 |
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封裝（單位：mm） |
最大用戶I/O （LVDS對(duì)）收發(fā)器 / DDR |
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FBGA784 (29x29x3.32, pitch 1.0) |
477 (144) / 4 / 32b |
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VFBGA324 (15x15x1.93, pitch 0.8) |
209 (64) / 0 / 16b |
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FCCSP324 (15x15x1.21, pitch 0.8) |
209 (64) / 0 / 16b |
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注：
1. 如果使用 DDR IP，所有 DDR 引腳都不能用作 IO.
2. ADC 可用于監(jiān)測(cè)內(nèi)部芯片溫度和電壓。
| 標(biāo)題 | 版本 | 發(fā)布日期 | 文件格式 |
| HME-Pegasus_P1P060 系列 FPGA 數(shù)據(jù)手冊(cè) | V_1.5 | 2023-01-22 | |
| HME-Pegasus_P1 產(chǎn)品介紹 | V_4.0 | 2017-01-31 | |
| HME-Pegasus_P1P060 Family_Data Sheet | V_1.7 | 2023-05-22 | |
| HME-P1 Family_User Guide_Clocking Resource | v_1.0 | 2022-09-21 | |
| HME-P1 Family_User Guide_ADC | V_1.0 | 2022-09-29 | |
| HME-P1 Family_User Guide_EMB | V_1.0 | 2020-10-25 | |
| HME-P1 Family_User Guide_FIFO | V_1.0 | 2022-10-27 | |
| HME-P1 Family_User Guide_Configuration Mode | V_1.0 | 2022-09-27 | |
| HME-P1 Family_User Guide_Hardware Design | V_1.0 | 2022-09-30 | |
| HME-P1P060_pinlist | V_1.2 | 2022-06-06 | Excel |
| HME-P1 系列應(yīng)用指南_IO 配置 | V_1.0 | 2023-05-08 | |
| HME-P1 Family User Guide LVDS | V_1.0 | 2022-10-21 |
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HME - P1（12）